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Vivado入门与提高(高亚军)
Vivado
TCL
xsim
共41课时 13小时51分12秒
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简介
本课程详细介绍了Xilinx新一代开发平台Vivado的使用方法,分为两大部分:入门篇和提高篇;涵盖四大主题:设计流程,时序约束(XDC),设计分析和Tcl脚本的使用;附带多个工程Demo。把Vivado “IP Centric”的设计理念贯穿其中,通过Demo显示了Vivado的强大功能和与ISE的不同之处。
课程目录
课时1:Vivado设计流程及使用模式 (17分48秒)
课时2:用三个DEMO讲解如何在设计中使用IP (31分34秒)
课时3:基于XSim的逻辑仿真 (24分12秒)
课时4:基于ModelSim的逻辑仿真(DEMO工程文件与第三讲一致) (8分25秒)
课时5:综合的基本设置和综合属性 (32分3秒)
课时6:实现 (27分26秒)
课时7:增量实现 (22分43秒)
课时8:Vivado里最常用的5个Tcl命令 (39分50秒)
课时9:编程与调试 (31分24秒)
课时10:输入输出和时钟规划 (21分56秒)
课时11:与Vivado设计流程相关的一些技巧 (26分34秒)
课时12:时序分析中的基本概念和术语 (24分43秒)
课时13:创建基本时钟周期约束 (32分21秒)
课时14:设置输入延时约束 (21分56秒)
课时15:设置输出延时约束 (14分32秒)
课时16:虚拟时钟 (14分37秒)
课时17:设置多周期路径约束 (17分21秒)
课时18:设置伪路径 (15分24秒)
课时19:约束的优先级 (17分7秒)
课时20:综合后的设计分析(1):资源与扇出分析 (19分18秒)
课时21:综合后的设计分析(2):时序分析 (20分45秒)
课时22:UltraFast设计方法学(1):初识UltraFast (12分0秒)
课时23:UltraFast设计方法学(2):时钟 (17分47秒)
课时24:UltraFast设计方法学(3):RTL代码风格(1) (17分3秒)
课时25:UltraFast设计方法学(4):RTL代码风格(2) (14分41秒)
课时26:UltraFast设计方法学(5):时序约束 (16分41秒)
课时27:UltraFast设计方法学(6):定义时钟分组 (18分6秒)
课时28:UltraFast设计方法学(7):如何管理IP约束 (12分30秒)
课时29:UltraFast设计方法学(8):在Vivado中使用设计规则检查 (15分6秒)
课时30:UltraFast设计方法学(9):理解实现策略 (22分59秒)
课时31:UltraFast设计方法学(10):时序收敛之时序约束基本准则 (19分12秒)
课时32:UltraFast设计方法学(11):时序收敛之10个时序收敛技巧 (25分38秒)
课时33:功耗估计和优化 (21分14秒)
课时34:利用Vivado IP Integrator进行设计开发 (18分5秒)
课时35:Tcl在Vivado中的应用(1):编辑网表 (21分23秒)
课时36:Tcl在Vivado中的应用(2):定制报告 (20分57秒)
课时37:Tcl在Vivado中的应用(3):使用Hook Script (15分4秒)
课时38:Tcl在Vivado中的应用(4):嵌入自定义Tcl命令 (12分55秒)
课时39:Tcl在Vivado中的应用(5):使用Xilinx Tcl Store (9分33秒)
课时40:Tcl在Vivado中的应用(6):工程模式下的设计流程管理 (22分3秒)
课时41:Tcl在Vivado中的应用(7):非工程模式下的设计流程管理 (16分16秒)
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