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如何使用Vivado HLS加速FPGA算法开发
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接口综合 — 基本介绍
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课程目录
课程笔记
课时1:软件工程师该怎么了解 FPGA 架构?
课时2:HLS 工作机制
课时3:Vivado HLS设计流程-基本概念介绍
课时4:Vivado HLS设计流程 -- 实例演示
课时5:如何处理任意精度的数据类型
课时6:数据类型的转换
课时7:了解 HLS 中的复合数据类型
课时8:Vivado HLS 中的 CC++ 基本运算
课时9:Vivado HLS 下 CC++ 测试平台的基本架构
课时10:描述高效的 C 测试平台:测试激励
课时11:描述高效的C测试平台 - 输出监测与格式控制
课时12:接口综合 — 基本介绍
课时13:接口综合 — 对数组的处理
课时14:接口综合 — 其他案例
课时15:FOR 循环优化 — 基本性能指标
课时16:for循环优化 — 循环合并
课时17:FOR 循环 — 数据流
课时18:FOR 循环优化 — 嵌套的 FOR 循环
课时19:FOR 循环优化 - 其他优化方法
课时20:数组优化 — 数组分割
课时21:数组优化 — 数组映射和重组
课时22:数组优化 - 其他优化方法
课时23:Vivado HLS 函数层面的优化
时长:15分11秒
日期:2018/12/25
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课程介绍
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FPGA
Xilinx
Vivado
算法
本系列教学视频由赛灵思高级战略应用
工程
师带领你从零开始,一步步深入掌握 Vivado HLS 以及 Ultra
FAST
设计方法,帮助您成为
系统
设计和
算法
加速的大拿!本课程包含五个主题:Vivado HLS的设计流程、采用C或C++描述算法时的
代码
风格、for循环的优化方法、数组的优化方法 、输入/输出端口的实现方式。
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