MAX 10 FPGA PLL和时钟培训

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MAX 10 FPGA PLL和时钟培训
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时长：7分2秒
日期：2015/06/09
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上传者：chenyy
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课程介绍

相关标签： FPGA Altera MAX 10 嵌入式闪存

MAX 10早在定义之初就被封为“下一代非易失FPGA”。Altera把大量的外围器件（包括振荡器、时钟、模数转换器、温度传感器等）集成到MAX 10中，而过去系统的核心32位处理器也可以用Altera的软核处理器Nios II来替代，这能够让电路板面积减小50%。

MAX 10的嵌入式处理功能也帮助其提高了系统价值。（1）MAX 10是单芯片嵌入式处理器系统，有软核Nios II处理器支持、更小的引脚布局且不需要外部RAM或者存储；（2）用户可定制处理器，具有MCU所不具备的灵活性；（3）支持实时应用，在10 ms内完成配置，这点是汽车和工业应用特别看重的；（4）维持较长的产品生命周期。

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用户评论

: Ylant; 干货，值得学习; 2020年03月07日 21:21:09回复|顶()

: chenyy; ljj3166 发表于 2015-6-9 17:20
CPLD的简约，FPGA的强劲，蛮强大的

是的，他们的取名也是很考究的。https://www.eeworld.com.cn/FPGA/2014/0930/article_3507.html 可以看看这篇文章，看是否有用; 2015年06月11日 09:06:35回复|顶()

: chenyy; 格古洛发表于 2015-6-9 16:44
感谢楼主分享，受教了~

只要你们觉得值得一看就好有什么好的设计视频也欢迎分享; 2015年06月11日 09:05:24回复|顶()

: ljj3166; CPLD的简约，FPGA的强劲，蛮强大的; 2015年06月09日 17:20:00回复|顶()

: 格古洛; 感谢楼主分享，受教了~; 2015年06月09日 16:44:32回复|顶()

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