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03 我们的第一个设计
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时长：19分2秒
日期：2017/07/26
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上传者：xuehua_12
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相关标签： FPGA 嵌入式至简设计法 EDA

明德扬至简设计法由拥有多年FPGA代码编写经验的潘文明老师首创，不仅能让初学者在短时间内掌握Verilog语言，而且编写出的代码简洁无冗余、准确度高。我们将通过一系列案例，让您得到关于Verilog的高效点拨。

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