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FOR 循环 — 数据流
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时长：12分40秒
日期：2019/03/20
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上传者：抛砖引玉
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课程介绍

相关标签： FPGA Xilinx Vivado 算法

本系列教学视频由赛灵思高级战略应用工程师带领你从零开始，一步步深入掌握 Vivado HLS 以及 UltraFAST 设计方法，帮助您成为系统设计和算法加速的大拿！本课程包含五个主题：Vivado HLS的设计流程、采用C或C++描述算法时的代码风格、for循环的优化方法、数组的优化方法、输入/输出端口的实现方式。

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