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UltraFast设计方法学(3):RTL代码风格(1)
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UltraFast设计方法学(3):RTL代码风格(1)
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课程目录
课程笔记
课时1:Vivado设计流程及使用模式
课时2:用三个DEMO讲解如何在设计中使用IP
课时3:基于XSim的逻辑仿真
课时4:基于ModelSim的逻辑仿真(DEMO工程文件与第三讲一致)
课时5:综合的基本设置和综合属性
课时6:实现
课时7:增量实现
课时8:Vivado里最常用的5个Tcl命令
课时9:编程与调试
课时10:输入输出和时钟规划
课时11:与Vivado设计流程相关的一些技巧
课时12:时序分析中的基本概念和术语
课时13:创建基本时钟周期约束
课时14:设置输入延时约束
课时15:设置输出延时约束
课时16:虚拟时钟
课时17:设置多周期路径约束
课时18:设置伪路径
课时19:约束的优先级
课时20:综合后的设计分析(1):资源与扇出分析
课时21:综合后的设计分析(2):时序分析
课时22:UltraFast设计方法学(1):初识UltraFast
课时23:UltraFast设计方法学(2):时钟
课时24:UltraFast设计方法学(3):RTL代码风格(1)
课时25:UltraFast设计方法学(4):RTL代码风格(2)
课时26:UltraFast设计方法学(5):时序约束
课时27:UltraFast设计方法学(6):定义时钟分组
课时28:UltraFast设计方法学(7):如何管理IP约束
课时29:UltraFast设计方法学(8):在Vivado中使用设计规则检查
课时30:UltraFast设计方法学(9):理解实现策略
课时31:UltraFast设计方法学(10):时序收敛之时序约束基本准则
课时32:UltraFast设计方法学(11):时序收敛之10个时序收敛技巧
课时33:功耗估计和优化
课时34:利用Vivado IP Integrator进行设计开发
课时35:Tcl在Vivado中的应用(1):编辑网表
课时36:Tcl在Vivado中的应用(2):定制报告
课时37:Tcl在Vivado中的应用(3):使用Hook Script
课时38:Tcl在Vivado中的应用(4):嵌入自定义Tcl命令
课时39:Tcl在Vivado中的应用(5):使用Xilinx Tcl Store
课时40:Tcl在Vivado中的应用(6):工程模式下的设计流程管理
课时41:Tcl在Vivado中的应用(7):非工程模式下的设计流程管理
时长:17分3秒
日期:2020/07/30
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上传者:抛砖引玉
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课程介绍
相关标签:
Vivado
TCL
xsim
本课程详细介绍了Xilinx新一代开发平台Vivado的使用方法,分为两大部分:入门篇和提高篇;涵盖四大主题:设计流程,时序约束(XDC),设计分析和Tcl脚本的使用;附带多个工程Demo。把Vivado “IP Centric”的设计理念贯穿其中,通过Demo显示了Vivado的强大功能和与ISE的不同之处。
显示全部 ↓
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用户评论
Free007
第10讲与第14讲重复了,但是缺少了第10讲 IO and clock palnning
2020年08月26日 18:46:30
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()
54chenjq
VivadoVivado设计流程及使用模式
2020年08月18日 22:20:39
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