课程介绍
Verilog HDL硬件描述语言概述
Verilog HDL自顶向下的设计思想
是选择Verilog还是VHDL
Verilog HDL有什么用处
如何避免竞争和冒险
行为级和RTL级
Verilog模块的编写与验证举例
ModelSim和Quartus的使用
Verilog模块的基本构成要素
Verilog HDL有什么用处 
Verilog中reg与wire的不同点
Verilog中阻塞与非阻塞
Verilog中两种不同的赋值语句
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    邮箱[email=ji271102@163.com]ji271102@163.com[/email],谢了
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    表示对MPLAB IDE完全不懂,求朋友给写好建议或视频
    书、视频都可以。。。。求高手
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