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FPGA中IP核的使用
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时长：13分17秒
日期：2015/05/07
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上传者：chenyy
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课程介绍

相关标签： FPGA Verilog HDL Altera Quartus II

基于Altera FPGA和Quartus II开发软件，带你学习FPGA设计技巧，提高你的FPGA设计技能。包括面积与速度的折中、硬件可实现、层次化设计以及同步设计等。

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用户评论

: 54chenjq; 基于Altera FPGA和Quartus II开发软件，带你学习FPGA设计技巧，提高你的FPGA设计技能。包括面积与速度的折中、硬件可实现、层次化设计以及同步设计等。; 2020年04月01日 23:58:44回复|顶()

: YCC-1156; 讲课谈不上，就整个最简单实用的，准备这么写， [用 Modelsim 跑最小 TestBench, 送给第一天用 Modelsim 的朋友] 你看怎么样; 2019年10月22日 04:44:26回复|顶()

: 5525; 白丁发表于 2016-6-6 22:47
期待给大家上一堂课讲讲

讲课谈不上，就整个最简单实用的，准备这么写，
[用 Modelsim 跑最小 TestBench, 送给第一天用 Modelsim 的朋友]
你看怎么样; 2016年06月07日 07:29:30回复|顶()

: 白丁; 5525 发表于 2016-6-4 16:24
同学们，为什么非要在 Quartus里面启动 sim,
正常开发里面，跑综合和跑 sim 都是独立开来 ...

期待给大家上一堂课讲讲; 2016年06月06日 22:47:57回复|顶()

: 5525; 同学们，为什么非要在 Quartus里面启动 sim,
正常开发里面，跑综合和跑 sim 都是独立开来，
sim 这块有专门的，分析，测试条目，激励向量，版本管理，跟踪，报告。; 2016年06月04日 16:24:04回复|顶()

: 白丁; 在quartus中没有设置modelsim的路径或者路径设置的不对，重新设置下试试; 2016年06月03日 18:29:59回复|顶()

: e与或非; 基于课程 Altera FPGA设计技巧提高实训的讨论 https://training.eeworld.com.cn/course/575

请问这是什么问题啊？怎么解决？; 2016年06月03日 14:43:43回复|顶()

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