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Verilog行为仿真
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时长：41分50秒
日期：2018/07/04
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上传者：老白菜
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课程介绍

相关标签： FPGA EDA RTL

课程目标是通过本课程及其它相关课程的学习，使学生能够掌握硬件描述语言设计数字系统的手段、方法和思想，掌握常用EDA开发软件,将HDL硬件描述语言编程方法和FPGA的开发技术及符合工程规范的系统设计技术有机地融合在一起。同时了解学科最新进展，理论与联系实际，培养学生的动手能力和综合创新能力。

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