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EEWORLD大学堂
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verilog HDL数字集成电路设计原理与应用
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电路设计方法概述
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课程目录
课程笔记
课时1:电路设计方法概述
课时2:语言要素 数据类型
课时3:运算符和表达式
课时4:数据流建模
课时5:行为级建模1
课时6:行为级建模2
课时7:结构化建模
课时8:语言设计思想和可综合特性、组合电路设计
课时9:组合电路设计 时序电路设计
课时10:时序电路设计
课时11:有限同步状态机
课时12:电路仿真和验证概述 测试程序设计基础
课时13:测试程序设计基础及仿真相关的系统任务 信号时间赋值语句
课时14:信号时间赋值语句
课时15:任务和函数
课时16:典型测试向量的设计
课时17:用户自定义原件模型UDP 基本门级原件和模块的延时建模
课时18:编译预处理语句 数字电路系统设计的层次化描述方法
课时19:典型电路设计1
课时20:典型电路设计2
课时21:可编程器件技术基础1
课时22:可编程器件技术基础2
课时23:可编程器件技术基础3
课时24:可编程器件技术基础4
课时25:设计方法与设计流程1
课时26:设计方法与设计流程2
课时27:设计方法与设计流程3
课时28:设计方法与设计流程4
课时29:设计约束及时序分析1
课时30:设计约束及时序分析2
时长:42分54秒
日期:2020/08/23
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上传者:桂花蒸
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课程介绍
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FPGA
ASIC
Verilog
Verilog HDL数字集成电路设计原理与应用 蔡觉平 何小川 西安电子科技大学 蔡觉平、李振荣主讲
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用户评论
菜鸟耍大刀
讲解得很不错,很适合理论入门学习????
2021年02月26日 13:30:09
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